RISC型CPUについて

1 名前：008.espresso mailto:sage [02/04/18 03:11.net] タイトル嘘！バーか、それろり バナー作ってやるからあプロだおしえれ！ 23 名前：名無しさん＠お腹いっぱい [02/08/15 11:16.net] P4のハイパースレッドは、ALUを時分割（というか交互？）して使って トランジスタ当たりのCPI (clock per instruction)を向上させるのだと 理解している。この方式は遠くはAppoloのPRISMアーキテクチャで実装 されていたと思う。 P4の場合にはスレッドというよりはALUが共用されたCPUが物理的に２個あ るように見えるので、本当に２CPUのマルチプロセッサとして動作する（ と理解している）。間違っていたら乞指摘。 24 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/15 11:23.net] CとIが逆とちゃうの? 25 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/15 14:40.net] >>24 検索しる。若者よ。 26 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/15 15:13.net] >>25 した。 逆数なんだから同じものだし、「向上」っていうと数字が増えた方がピンとくるなあ、と思った次第で。 計算機科学的にはCPIの方が由緒正しい用語っぽいですか? 27 名前：25 mailto:sage [02/08/15 15:22.net] >>26 単に1を境に主流が入れ替わっただけと感じてる。 昔の世界ではIPC 0.25よりCPI 4の方が直感的だったわけで。 28 名前：24=26 mailto:sage [02/08/15 15:37.net] >>27 なるほど! 歴史を肌で感じていないと出てこないお言葉です。 自分が若者だということがわかりました。ヽ(´▽｀)ﾉ 29 名前：23 [02/08/15 22:06.net] ご指摘のとおり、　CPIを低減させる　という表現のほうが正しいですね。 CPIは少ないほど良いです。すみません。　（RISCのCPI戦争は10年昔の 話だから、ボケちゃったよ） 30 名前：しろうと [02/08/16 01:07.net] お前ら何しゃべってんのかわかんねーけど、 なんかカコイイぞ！！ 31 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/16 07:27.net] >>30 お勧めできない。 32 名前：名無しさん＠お腹いっぱい。 [02/08/16 11:36.net] RISC型CPUは、リスクを伴なう。 33 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/16 12:40.net] 　　　　　　　　　　　　　　　　　　　　　　　　丶　l　/ 　　　　　こんなのイヤ〜っ！！　　　　　　　>>32 .　　　　　　　　　　　　　　　　　　　　　　　　／/ l　ヽ 　　　　　　　　　　　　　　　　　　　　　　　　 /　 l　　） 　　　　　　　　　　　　　　　　　　　　　　 ／　　ﾉ 　　　　　　　　　　　　　　　　　　　　 W∠　 ／ 　　　　　　　　　　　　　 _　-‐-､　 (⌒) く 　　　　　　　　　　__ - ~　 -‐-　ヽ/ / 　　　　　,. -‐　~　　 　 丿ノハ ）） / 　　　　（　（ (　／　 | | (＞)(＜)|／ 　　　　　　（ 　　__(⌒)ﾞ､⊂つ／ヾ､ 　　　　　　／`|＼ ／ヽ､| ヾヽヾ　)ﾉ 　　　　　　~｢ /＼＿＿|　　　)ﾉ 　　 　 　 　 |/　/　 / 34 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/16 13:26.net] RISCの敗因、CISCの勝因 www.atmarkit.co.jp/fsys/zunouhoudan/027zunou/end_of_risc.html 35 名前：名無しさん＠お腹いっぱい。 [02/08/16 14:47.net] いとしの林檎ちゃんを射止めるのは、RISC、CISCどっちかな？ 36 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/16 19:04.net] >34 x86 は内部は RISC みたいなもんでしょ？ 37 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/16 19:50.net] これからはなんでもありのMISCの時代です。 38 名前：Be名無しさん [02/08/27 08:15.net] >>13 ハイパースレッド≠ダイ内マルチプロセッサ でOK? 39 名前：New Tech. SITE ◆NtVkSITE mailto:sage [02/08/27 08:26.net] >>32,>>36 ワロタ。 40 名前：名無しさん＠お腹いっぱい。 [02/08/27 18:24.net] お好みのCPUは何? 41 名前：New Tech. SITE ◆NtVkSITE mailto:sage [02/08/27 21:59.net] >>40 漏れは PowerPC ダイチュッキ♪ 42 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/31 02:33.net] >>38 ダイ内TSSと考えた方がよい >>40 68030 43 名前：New Tech. SITE ◆NtVkSITE mailto:sage [02/08/31 21:55.net] 間違えた。 ワラタのは >>36 じゃなくて >>37 ですた・・・。 44 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/08/31 22:39.net] >>40 RISCじゃ無いけど、H8。 なぜか目の前に転がってるので、遊んでます。 45 名前：名無しさん mailto:sage [02/09/01 23:47.net] >>34 「x86, RISCの勝因、(x86以外の)CISCの敗因」だな。 特に鋭いことは言ってない。 46 名前：名無しさん＠お腹いっぱい。 mailto:sage [02/11/16 10:08.net] テスト 47 名前：名無しさん＠お腹いっぱい。 [02/12/11 00:30.net] 固定命令長のRISC型CPUの方がCISC型にくらべて ２倍ぐらい実行速度が速いって認識でいいの？ そいで完全CISC型CPUは現場にはもう存在してないと、、 48 名前：名無しさん＠お腹いっぱい。 [02/12/11 00:43.net] >>45 なんか日経なんとかの丸写しっぽいね。5点。 49 名前：48 mailto:sage [02/12/11 00:53.net] ごめん、間違った。「DOS/Vマガジンあたりにありそうな 薄っぺらな記事」だった。 50 名前：名無しさん＠お腹いっぱい。 [02/12/11 01:18.net] >>44 擦るな！ 51 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/01/04 13:22.net] > x86 は内部は RISC みたいなもんでしょ？ この話はよく出てくるけど、具体的な内部構造とか、X86 命令がどう内部的に 処理されてるかがわかりやすく書いてあるとこはないのかな？ レジスタが足りないせいで、やたらとメモリにアクセスする X86 命令を内部の レジスタアクセスに置き換えていてステートが必要なときに初めてキャッシュにかく みたいな事をやってるんだろうか？それとも、その辺は高いクロックとでかい キャッシュで吸収ってことになってるんだろうか？ その内部に持ってる RISC を直接使えるようにしてくれれば、RISC でないと できないようなオプティマイズの恩恵も受けられそうな気がするんだけど そういうのは無理なのかな？それで Itanium のように X86 命令も実行 できるようにしておいて、直せるところから RISC ベースのコードにかえて いけば OS, アプリももっと速くなると思うんだが... (Big Endian で) それとも X86 命令をデコードして実行する内部回路はそんな必要もないほど 速いのかな？ 52 名前：名無しさん＠お腹いっぱい。 [03/01/04 14:57.net] 内部の RISC 化で何とかしようとしたけど X86 アーキテクチャが足を引っ張って パイプラインや実行ユニットの利用効率が低いからハイパースレッティングで 他のものを走らせる余地があるってことか... 幸いレジスタコンテキストは小さいので 複数のものを切り替えるのもオーバーヘッドがちいさいと。 53 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/01/04 20:34.net] >>51 Itanium の X86 命令は後方互換性のためだけにあるんじゃ？ 同じように持ってるPA-RISC の命令セットもそう。 Itanium では実用に程遠いほど遅いって聞いたぞ。 McKinley ではどうだろう。使ってみたヤシはいないのか？ 54 名前：51 mailto:sage [03/01/04 22:01.net] > Itanium の X86 命令は後方互換性のためだけにあるんじゃ？ それはそう。仕組みはよくわからんが、Pen* ほどはこってないのかも。 こっても意味ないし。486 とかの回路が入ってたりして。遅いって、 どの程度おそいんだろ？ Itanium は PA-RISC の命令も持っていると思ってたけど、そうではなくて、 PA-RISC のコードはソフトウェア変換で実行してる。IA64 HP-UX だと、 これはインタープリタとトランスレータの2段がまえで最初のうちはインタープリタ で動かして、統計をとってよく呼ばれる部分は（オプティマイズをかけて）IA64 の 命令に変換してる。このオプティマイズのときに Itanium 特有のオプティマイズの 恩恵もうけられる。Java の HotSpot によく似てる。PA-RISC 版の Java を 動かすと HotSpot で byte code -> PA-RISC 変換をやって動くことになる けど、その自体が PA -> IA64　インタープリタ、トランスレータの上で動くと いうややこしいことになる。さすがに native な IA64 コードにはかなわないが、 その数分の１程度の実行速度は出るらしい。X 周りとか、PA のままの プログラムも残ってるけど、気になるほど遅いということはない。 Itanium2 は実行ユニットの追加、パイプライン、メモリ、キャッシュ周りの 改良が効いたのか、ベンチマークではいい数字出してるみたい。 55 名前：51 mailto:sage [03/01/04 22:26.net] ま、思ったのは x86 命令を変換実行して、他のプロセッサにもパフォーマンスで 負けない Pentium* の内部 RISC を直接動かせれば足かせがなくなって最速 プロセッサってことにならないかなということ。 その内部 RISC ってのも x86 アーキテクチャに依存していてとても汎用プロセッサにはできないってところかな？ 56 名前：名無しさん＠お腹いっぱい。 [03/01/05 12:43.net] レジスタリネーミングやアウトオブオーダーというのをご存知ですか? 57 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/01/05 12:45.net] P4は内部に128本の汎用レジスタを持ち、これをリネーミングして使う ことで、メモリアクセス回数を減らしています。 P6のときは内部32本でした。 58 名前：名無しさん＠お腹いっぱい [03/01/05 17:11.net] レジスタリネーミングはパイプラインのハザードを低減させる技術であって、 メモリアクセス回数を減らす技術はキャッシュとかライトバッファと思うが 如何。 59 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/01/05 19:06.net] >>55 Transmetaはどうなんだろう。今はやっぱりx86特化してるのかな？ (専門外なのでテキトー書いてます) 60 名前：51 mailto:sage [03/01/05 ] [ここ壊れてます] 61 名前： 21:08.net mailto: > レジスタリネーミングやアウトオブオーダーというのをご存知ですか? > P4は内部に128本の汎用レジスタを持ち、これをリネーミングして使う > ことで、メモリアクセス回数を減らしています。 Sparc の in/local/out とか Itanium の gr32~127 を使いまわすようなことを 言うのかなといった程度の理解です。似たようなことを完全に内部で やってるのかな？オーバーフローしたときはバッキングストアに書く代わりに x86 レベルにさかのぼってメモリに書くってこと？メモリアクセスをレジスタ リネーミングで解決しているとするとアドレスを保存するためにもう1つレジスタが 必要になりそう。 アウトオブオーダー実行はどの範囲でやるんだろ？ブランチが多いと効果も 小さいかも。 x86 でメモリ上の値を変更する命令と変更後の値を使う命令をメモリアクセス なしに内部のレジスタで済まして x86 のコンテキストを確定するまでメモリに 書き出しもしないということであればスゴイ。 > Transmetaはどうなんだろう。今はやっぱりx86特化してるのかな？ http://www.geocities.co.jp/SiliconValley-Cupertino/6209/#Transmeta%20Crusoe の解説によると x86 依存のハードを持っているみたい。 Transmeta の Midori Linux はひょっとして Crusoe ネイティブかと思ったんですが、 x86 モードのようですね... [] [ここ壊れてます] 62 名前：58 [03/01/05 22:27.net] >>60 マルチプロセッサ構成のことを考えると、ストア命令が発行されたら、 値をキャッシュに書かなければダメなんでないかい？内部レジスタが たくさんあったとしてもこの操作ははしょれないと思う。 63 名前：60 mailto:sage [03/01/06 00:24.net] >>61 そうですね。 128個もレジスタを持つ CPU コアを 3G over で出せるのなら、そのまま RISC として 出せばよいと思うんだが... それよりも互換性ってことが。 x86 アーキテクチャって あとどれくらい生き延びるんだろ？ 64 名前：山崎渉 mailto:（＾＾）sage [03/01/15 13:01.net] （＾＾） 65 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/03/12 04:17.net] >>62 廃れてるなぁ... 内部RISCなCISCの内部だけとりだすと、コード爆発のあおりで性能低下するでそ。 ということで、くるーそーのネイティブモードは86互換モードより遲いらしい。 66 名前：山崎渉 mailto:（＾＾） [03/04/17 12:34.net] （＾＾） 67 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 68 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/10 17:15.net] >>62 どう見たって、まず互換性ありきだろう。 歴史的な経緯を見れば当たり前といえるし。 例えば、ものすごく高性能な新種のCPUが出たからって、買うか？ x86に蓄えられた莫大な資産を捨てるのか？ 69 名前：名無しさん＠お腹いっぱい。 [03/05/10 23:48.net] >>67 > 例えば、ものすごく高性能な新種のCPUが出たからって、買うか？ > x86に蓄えられた莫大な資産を捨てるのか？ そろそろ捨てたいけどな． だから，Opeteronとかよしてくれ！って思う． 70 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/11 00:59.net] x86系は熱処理周りで完全に限界に達しちゃったと思うしね。せっかく オープンソース系 OS & アプリと Java のおかげでバイナリの縛りが弱く なってきているんだし、低消費電力・低発熱な新規アーキテクチャの CPU に乗り換えたいよ。 71 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/11 01:07.net] PowerPC捨てろ。 あのx86よりスパゲッティで力任せな構成は許せん！ やっぱMIPS系最高。 72 名前：68 mailto:sage [03/05/13 06:50.net] 世の中すべてがｵｰﾌﾟﾝｿｰｽ&Javaな訳ではない。 当然捨てるに捨てられないものを抱えた会社も多いわけで。 >>70 余談だけと、漏れはx86（とその周辺）の見苦しい仕様は好きだな。 あれだけ汚いと、むしろ。 73 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/13 11:51.net] 最高だ、PowerPCG3。 74 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/13 12:57.net] SH: 現行最強。 x86: 苦し紛れの仕様に開発者の苦悩が垣間見える。 PPC: M68系の頃の芸術性はどこへやら。センスの欠片も感じられない。 Alpha: 強者達の夢の後。 SPARC: F通ガムバレ。 MIPS(VR): … 75 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/13 15:38.net] >>73 s/SH/ARM/ ? 76 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/13 23:35.net] >>74 ひそかにSHおもしろいよ。最近展開も増えてるし。でもARMが安いのでARM使うけどな。 77 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/13 23:55.net] だれか、M32とか、AM32とかFR30とかC33とかのレビューキボンヌ 78 名前：名無しさん＠お腹いっぱい。 [03/05/14 01:42.net] >>76 Power4, IPF, PA-RISCもたのんます． どれも，命令セットとかアーキとかどうでもいい使い方しかされてないし， 買ってきて使うこともできんが． 79 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/14 02:54.net] >>77 PA-RISC先がないやん。HPはIA64一本に絞るんでしょ。 80 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/14 02:57.net] >>70 PowerPCの不思議なところは、あのPowerと68とを適当に混ぜた汚ね〜archでも そこそこ低消費電力なとこ。もっとも、CPUパワーが圧倒的に足りてないから 結果的に低消費電力になっているだけなのかも。 81 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/14 12:23.net] 一度ギガオーバーのSPARC64使ってみたい。 82 名前：名無しさん＠お腹いっぱい。 [03/05/14 13:32.net] 15Kでいいじゃん。うるさいけど。 83 名前：67 mailto:sage [03/05/14 21:23.net] （実は>>71を書いたのは67ﾃﾞﾂ。ﾏﾁｶﾞｴﾏｽﾀ） >>81 漏れも「15Kでいいじゃん」といえるようになりたいな。 でも、どっちかと言ったらSR8000が欲しいな。 何となく形がそれっぽいし。 84 名前：74 mailto:sage [03/05/14 22:10.net] >>75 SH5が表に出てこないのが… SuperH Inc.がもっとがんばらないと永遠にこのままになりそうだし。 コア売りはあんまり興味なし。 >>76 M32はあんまり景気のいい話は聞かないなー。 犬のポーティング成果を公開すれば、盛り上がると思うんですけどね。 NetBSD Developerの餌食になるのは確実でしょう。 85 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/14 22:52.net] Renesusの廻し者ハケーン. 86 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/14 23:56.net] >>83 M32RE?もSH5も「石が入手できそうにない」ので、盛り上がらないとおもふ。 そんな石のどちらもLinuxが動いてるところが、なんか世の中斜めに進んでると思う。 87 名前：74 mailto:sage [03/05/15 23:55.net] >>84 廻し物つーか、日立と三菱しか伝手がないの。 それ以外だと…C33は評価ボードが死ぬほど高いという噂を聞いた事があるくらいかな？ >>85 どっちも量産可能なんだよねえ。あとは人柱の問題か。 88 名前：67(日立社員) mailto:sage [03/05/16 23:24.net] 廻し物は俺だ。偽物は消えろ。 SH5を使ったPCどこか作らないだろうか？ 値段にもよるが、人柱の覚悟はできている。 89 名前：74 mailto:sage [03/05/17 13:43.net] >>87 SH5のSolutionEngine作ってくれ。 10万以下なら買う。 90 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 91 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/24 22:36.net] で、MIPSはもう絶命なのか？ 92 名前：名無しさん＠お腹いっぱい。 mailto:sage [03/05/24 22:59.net] >>90 学校で使う教材はほとんどMIPS。 CASLみたいな存在だ。 93 名前：90 mailto:sage [03/05/24 23:26.net] >>91 つまり紙の上だけの存在になりつつあると。(ゲーム機を除く) 94 名前：名無しさん＠お腹いっぱい。 [03/05/25 22:58.net] >>90 SetTopBoxの業界においては、ほぼスタンダードとなっているらしいよ。 www.wince.ne.jp/snap/ceSnapView.asp?PID=740 95 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 96 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 97 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 98 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 99 名前：あぼーん mailto:あぼーん [あぼーん.net] あぼーん 100 名前：名無しさん＠お腹いっぱい。 [04/10/08 21:20:23.net] ﾐｯﾌﾟｼｭ とｴｽｴｯﾁｭ とｱｰﾐｭ ﾄﾞｯﾁｭ がいいでしゅかゅ？ 101 名前：ネット代月6万 mailto:sage [04/10/19 00:13:42.net] 　　　　 　 /＼＿＿_／ヽ 　　　　／ﾉヽ　　　　　　 ヽ、 　 　　/　⌒''ヽ,,,)ii(,,,ｒ'''''' :::ﾍ 　　　 | ﾝ（○）,ﾝ　<､（○）<::|　　|｀ヽ､ 　　 　|　 ｀⌒,,ﾉ(､_, )ヽ⌒´ ::l　　|::::ヽl .　　　ヽ　ヽ iｌ´ﾄｪｪｪｲ｀ｌi　ｒ ;/　 .|:::::ｉ | 　　　／ヽ　 !ｌ |,ｒ-ｒ-| ｌ! 　 /ヽ　 |:::::ｌ | 　　/　　|^|ヽ､ ｀ﾆﾆ´一／|　　　^|｀,ｒ-|: 102 名前：名無しさん＠お腹いっぱい。 mailto:sage [05/03/02 22:46:09 .net] 103 名前：名無しさん＠お腹いっぱい。 [2005/11/21(月) 11:31:07 .net] 中野　ただね、今のＭＰＵは、ＣＩＳＣはＲＩＳＣの技術を 　　　　　　どんどん取り入れる一方で、ＲＩＳＣチップ自体が 　　　　　　命令数をどんどん増やすとか、ＣＩＳＣに近づいているような状態で、 　　　　　　ＲＩＳＣかＣＩＳＣか、という論争は無意味に 　　　　　　なりつつあるのは事実ですよ。 新田　そこなんです。結局のところ坂村教授が考えたものの一つは、 　　　　　　多様な用途向けに作られた様々な種類のＭＰＵが、 　　　　　　統合化された電脳環境の中でスムーズに命令をやり取りできるための、 　　　　　　整合性のある命令セットの統一なんです。 　　　　　　だから当時のワークステーションの用途に合せて 　　　　　　命令セットを制限するのは困ると。 　　　　　　そのワークステーションですら「マルチメディア機能」とかの 　　　　　　付加が必要になって、命令数を増やしてＣＩＳＣに近づいているのは、 　　　　　　坂村教授の見通しが正しかったという証拠じゃないでしょうか。 104 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/21(月) 11:42:00 .net] 私の名前は中野です 105 名前：名無しさん＠お腹いっぱい。 [2005/11/21(月) 13:40:56 .net] 新田　最初にトロンチップ設計作業を実際にやったのは、 　　　　　　６８のセカンドソースやってた日立の技術陣ですから、 　　　　　　Ｇマイクロのような具体的な製品の回路で、 　　　　　　トロンチップ仕様で決めてないインプリメントに任された部分で 　　　　　　似てる部分はあるかも知れませんが、 　　　　　　トロンチップ仕様そのものが「真似」というのは違いますよ。 　　　　　　こういう「〜の真似」という言い方でトロンチップを非難した人が、 　　　　　　一方で同様に６８と似てるＮＥＣのＶ７０を 　　　　　　「本物の独自ＭＰＵ」などとおだてたりしてるんですから・・・ 古木　トロンチップだって絶滅寸前でしょうが！ 新田　そうでもありませんよ。 　　　　　　そもそも「ＲＩＳＣの時代だ」なんて言ったって、 　　　　　　アメリカで作られたＭＰＵで売れてるのは 　　　　　　インテルとスパークだけでしょう。インテルはＣＩＳＣだし。 　　　　　　パソコン・ワークステーションは「互換性」の壁で、 　　　　　　結局は入る隙間が無いですが、 　　　　　　組み込みチップとしてＧマイクロでもローエンドなやつとか、 　　　　　　９３年頃に開発されたＭ１６はかなり広範囲で使われています。 106 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/21(月) 17:43:31 .net] >>104 × ６８と似てるＮＥＣのＶ７０を 〇 VAX と... マニュアルの作りまでそっくりだったな. 107 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/22(火) 01:32:23 .net] TRONは宗教で坂村教授は教祖だな 108 名前：名無しさん＠お腹いっぱい。 [2005/11/22(火) 16:13:58 .net] 中野　Ｍ１６ってトロンチップだったんですか？ 　　　　　　ＳＨマイコンあたりと並べてトロンチップと対比して、 　　　　　「落ち目のトロンチップに比べて、日本製でも売れてる」と 　　　　　　引き合いに出す人もいるけど・・・ 新田　トロンチップですよ。 　　　　　　三菱はトロンチップの最ローエンド品の、Ｇマイクロ１００が 　　　　　　一番売れたんで、さらに下のＭ１６を造ったんです。 中野　１３０ＭＩＰＳのＧマイクロ５００はよく言われていたようですが。 古木　１３０ＭＩＰＳ？、トロンチップが、ですか？ 中野　そうですよ。 　　　　　　トロンチップはＣＩＳＣだから 　　　　　　遅くて使い物にならないから潰れた・・・ 　　　　　　なんて言ってる人がいるけど、それは大間違いなんです。 109 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/24(木) 11:52:12 .net] >>106 似たようなことは、 TRON CHIP 作ってたメーカの連中も言ってた。 求心力の中心みたいな言い方だったけど… 110 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/24(木) 15:48:53 .net] 新田　大体、日本企業がみんなＲＩＳＣを 　　　　　作るようになった・・・って言っても、 　　　　　ＳＨ１なんかそれほど早い訳じゃないですしね。 中野　むしろ、構造が単純で 　　　　　　低コストだけど性能はそこそこ・・・ってあたりが、 　　　　　　日本企業が組み込みチップとして 　　　　　　ＲＩＳＣを多用したメリットじゃないかな。 新田　なるほど、ＳＨマイコンは安さで売ってるわけか。 古木　家電の組み込みには必須な長所だと思いますよ。 中野　多様な整合性ある命令セットが必要なら、 　　　　　　インテル互換チップがやってるみたいに、 　　　　　　中身をＲＩＳＣで作って、トロンチップの命令セットは 　　　　　　エミュレーションで・・・って訳にはいかないんですか。 新田　別にそれでもいいんですよ。 　　　　　　Ｍ１６なんかは、どちらかというと、そういう作り方をしてます。 　　　　　　要は多様なチップでの命令に整合性が取れればいいんですから。 　　　　　　そこらへんが互換の要で、知的所有権でも一番やっかいな所ですからね。 111 名前：名無しさん＠お腹いっぱい。 mailto:age [2005/11/29(火) 16:13:06 .net] 当時はワークステーションっていってたけど。まだ HP が APOLLO ってのと別れてた頃で CPU のアーキテクチャは RISC が最先端だった。 SUN（SPARK）と HP（PA-RISC）が双璧だったっけ。 日本からも NEC の R3000 だとかがんばってたけど、全然ダメだった。 その後トロンで花開いたようだけど。ソフトは GNU の文化。 パブリックドメインという考え方が生まれた頃かな。 そしたら IBM-PC が DOS-V って言われるようになって、IBM の OS-2 と Microsoft の Windows に別れていったっけ。 このころ、今までの 8086 アーキテクチャが DX4 あたりで CISC（並行処理のできない遅れたチップ）と呼ばれけなされていたところへ、 Pentium で復活をなした。まさか、CISC が復活するとは思わなかったけ。 112 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/29(火) 16:26:27 .net] なんだかいろいろ突っ込みどころ満載の文章ですね。 113 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/29(火) 17:01:15 .net] これはこれで、おもしろい文章だと思うのでそっとして置くほうがいいんじゃないかな。 114 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/29(火) 18:11:20 .net] >>110 blog からのコピペ。 115 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/11/30(水) 02:13:06 .net] AMD Am29kが未出…。 116 名前：名無しさん＠お腹いっぱい。 mailto:sage [2005/12/04(日) 13:11:31 .net] FRISC型CPUはまだ出ないのですか。 ケツがむずむずしてたまりません（＞＜。） 117 名前：名無しさん＠お腹いっぱい。 [2005/12/30(金) 19:13:08 .net] RISCの方がいいのになぁ。 やっぱWindowsの力が強すぎなんだ。 Dvorak配列が一般化しなかったように良いものが残っていくとは限らないのか。 118 名前：名無しさん＠お腹いっぱい。 [2006/01/01(日) 02:17:19 .net] 悪貨は良貨を駆逐する 119 名前：名無しさん＠お腹いっぱい。 mailto:sage [2006/01/03(火) 08:45:00 .net] >>116 PowerPC版WindowsやAlpha版Windowsは普及しませんでしたが、何か。 120 名前：名無しさん＠お腹いっぱい。 [2006/01/13(金) 03:25:31 .net] だってWinなのにWin用工口ゲーが動かないんだもん。 121 名前：名無しさん＠お腹いっぱい。 [2006/01/18(水) 14:02:45 .net] 925 名前：名無しさん＠お腹いっぱい。 投稿日：2005/08/31(水) 19:11:17 ID:QK9vyS8a >>921 >TRONプロジェクトへの参加を理由にしてCISCの開発経験を積んでおこうというものだ。 CISCの開発経験なんか、RISC作りには有害無益でしかありませんが、何か？ >あのタイミングを逃したらそれ以降開発費を投じて研究など出来なかったであろうから。 なら、なんとしてもRISC作らなきゃいかんかっただろ というか、TRONチップで懲りて、以後開発費を投じての研究が出来なくなったわけだ >自社でμPD系独自CISCを開発してたNECが見向きもしなかったのも当然だ。 じゃあそのNECは、CISCの開発経験をもとに、何を作った？ MIPSのセカンドソースか？(w CISCの開発経験をもとに、SHという全く性能のでないCISCを作った日立よりは、マシだけどな 122 名前：名無しさん＠お腹いっぱい。 mailto:sage [2006/01/18(水) 14:03:35 .net] 347 ：Be名無しさん ：2005/09/01(木) 10:53:12 932 名前：名無しさん＠お腹いっぱい。 投稿日：2005/08/31(水) 21:41:16 ID:fNC0iRUP >>925 >CISCの開発経験なんか、RISC作りには有害無益でしかありませんが、何か？ 初期のRISCはCISCからマイクロコードを追い出して、それ込みでコンパイラに 最適化させる事で実行速度を向上させられるのがウリだったと理解している。 逆に言えば多段パイプラインを持つCISCを作れりゃRISC開発は楽勝で、将来 高機能化の流れになっても対応しやすかったと考える。 「無益」はともかく「有害」と言い切る根拠を述べよ。 >というか、TRONチップで懲りて、以後開発費を投じての研究が出来なくなったわけだ そういう話は聞いた事が無いな。否定はせんがね。そうだと思うなら根拠を述べろ。 ソースを示すか、君自身の考察を聞かせろ。 俺自身は、当時「世の流れが組み込み系へシフトして、コア機能の進化よりも 周辺機能の取り込みとカスタマイズの容易さが重視された」とする報道に 説得力を感じる。カネにならないハイエンド製品の開発は止めただけだろう。 つまり、CISCもRISCもへったくれもないわけだよ。 >自社でμPD系独自CISCを開発してたNECが見向きもしなかったのも当然だ。 >じゃあそのNECは、CISCの開発経験をもとに、何を作った？ >MIPSのセカンドソースか？(w 肝心の本家MIPSはハイエンドCPUを実装出来てたか？　仕様をブチ上げるだけで 実装してたのはNECじゃないか。大体、RISCオンリーのプロセッサ屋でハイエンド 製品を継続的に実装出来てた事例はあるのかね？ 123 名前：名無しさん＠お腹いっぱい。 [2006/05/28(日) 12:21:50 .net] >>120 >CISCの開発経験をもとに、SHという全く性能のでないCISCを作った日立 このへん、もうちょっと詳しく聞きたいな。 ベンチマーク比較を見るかぎり、結構な速度が出ているように見えるのだが、 ttp://www.l-and-f.co.jp/Dhrystone.htm 確かに、実際に使ってみると、ハタと止まって動きがなくなる瞬間がある。 アーキテクチャに欠陥でもあるのかなと、気になってはいるんだ。

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