暇だからVHDLでも書こうかな
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282:デフォルトの名無しさん
06/05/24 23:03:50
【Verilog】記述言語で論理設計 Project4【VHDL】
ｽﾚﾘﾝｸ(denki板)
【FPGA/CPLDスレ】 XILINX/ALTERA/Lattice/Actel 05
ｽﾚﾘﾝｸ(denki板)
こんなとこかな
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4852日前に更新/76 KB
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